- 産業: Semiconductors
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Texas Instruments (TI) designs and manufactures analog and digital semiconductor IC products for the world market. In addition to analog technologies, digital signal processing (DSP) and microcontroller (MCU) semiconductors, TI designs and manufactures semiconductor solutions for analog and digital ...
Chercher, exécuter, accéder aux séquences de pipeline. Le pipeline d'unité entier instruction-exécution pour le processeur principal. Stade l'extraction comprend l'instruction et extraction de l'opérande ; l'étape execute comprend les opérations et registre à Registre mouvements ; et l'étape de l'accès facultatif comprend l'accès à la mémoire (charges et magasins).
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La partie du code que les nombres premiers le pipeline dans une boucle de logiciel-en pipeline. Voir aussi prolog.
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Bits de recevoir-interruption de FIFO. Bits dans le registre de contrôle de port série synchrone (SSPCR) qui a une condition de trigger interruption basée sur le nombre de mots dans la mémoire tampon FIFO de réception.
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La partie des adresses de mémoire de données qui ne sont pas attribués comme global par le registre d'allocation mémoire globale (GREG). Si aucune des adresses de mémoire données sont attribués pour l'utilisation globale, tous de l'espace de données est locale. , Voir espace de données aussi global.
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Bits de transmettre-interruption de FIFO. Bits dans le registre de contrôle de port série synchrone (SSPCR) qui a une condition de trigger interruption basée sur le nombre de mots dans la mémoire tampon FIFO de transmission.
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La partie de la fenêtre de commande ou de la fenêtre de gestionnaire (PDM) de débogage parallèle où le débogueur/PDM se fait l'écho d'entrée de la commande, montre la sortie de la commande et répertorie les messages d'erreur ou les progrès.
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La partie de la fenêtre de commande, où vous pouvez entrer des commandes.
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Tout d'abord en première place. a file d'attente, un tampon matériel ou de la structure de données dont les éléments sont pris dans le même ordre qu'ils ont été mis po A FIFO est utile pour la mise en mémoire tampon d'un flux de données entre un émetteur et un récepteur qui ne sont pas synchronisés, c'est l'expéditeur et le récepteur ne sont pas envoi et la réception au même rythme. Si les taux diffèrent par trop dans une direction depuis trop longtemps, le FIFO devient plein (blocage de l'expéditeur) ou vides (blocage du récepteur).
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La partie du signal vidéo composite qui indique le récepteur où placer l'image dans la dimension de gauche à droite.
L'impulsion de synchronisation horizontale indique le système de réception où le début de la nouvelle ligne de balayage est. Voir aussi vertical sync.
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